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AD9154四路16位數(shù)模轉(zhuǎn)換器解決方案
文章來源: 更新時(shí)間:2015/6/6 9:19:00
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ADI公司的AD9154是四路16位2.4 GSPS最高采樣速率的數(shù)模轉(zhuǎn)換器(DAC),可以在基帶模式下產(chǎn)生高達(dá)奈奎斯特頻率的多載波.支持輸入數(shù)據(jù)速率高達(dá)1 GSPS,具有先進(jìn)的低雜散與失真設(shè)計(jì)技術(shù),主要用在無線通信,多載波LTE和GSM基站,寬帶中繼器,軟件定義無線電,寬帶通信,點(diǎn)對(duì)點(diǎn)微波無線電,發(fā)射分集、多路輸入/多路輸出(MIMO)以及儀器儀表和自動(dòng)測(cè)試設(shè)備.本文介紹了AD9154產(chǎn)品特色,優(yōu)勢(shì)和特點(diǎn),功能框圖以及評(píng)估板AD9154-EBZ主要特性,電路圖,材料清單和PCB元件布局圖.
AD9154是一款四通道、16位、高動(dòng)態(tài)范圍數(shù)模轉(zhuǎn)換器(DAC),提供2.4 GSPS最高采樣速率,可以在基帶模式下產(chǎn)生高達(dá)奈奎斯特頻率的多載波。 AD9154具有針對(duì)直接變頻傳輸應(yīng)用進(jìn)行優(yōu)化的特性,包括復(fù)數(shù)數(shù)字調(diào)制、輸入信號(hào)功率檢測(cè)以及增益、相位與失調(diào)補(bǔ)償。DAC輸出經(jīng)過優(yōu)化,可以與ADI公司的ADRF672x射頻正交調(diào)制器無縫接口。在混頻模式下,DAC可在二階和三階奈奎斯特區(qū)內(nèi)重構(gòu)載波。串行端口接口(SPI)允許對(duì)內(nèi)部參數(shù)進(jìn)行編程和回讀。滿量程輸出電流可以在-4 mA至-20 mA范圍內(nèi)進(jìn)行編程。 AD9154提供88引腳LFCSP封裝。

AD9154產(chǎn)品特色:
超寬信號(hào)帶寬支持新興的寬帶和多頻帶無線應(yīng)用。
先進(jìn)的低雜散與失真設(shè)計(jì)技術(shù),從基帶到高中頻的寬帶信號(hào)可以實(shí)現(xiàn)高質(zhì)量合成。
JESD204B子類1可簡(jiǎn)化多芯片同步。
小型封裝,尺寸為12 mm × 12 mm。
AD9154優(yōu)勢(shì)和特點(diǎn):
支持輸入數(shù)據(jù)速率高達(dá)1 GSPS
專有低雜散與失真設(shè)計(jì)
單載波LTE 20 MHz BW,ACLR = 76.7 dBc(180 MHz IF時(shí))
六載波GSM IMD = 78 dBc(600 kHz載波間距,180 MHz IF時(shí))
SFDR = 72 dBc(180 MHz IF時(shí),−6 dBFS)
靈活的8通道JESD204B接口
多芯片同步
固定延遲
數(shù)據(jù)發(fā)生器延遲補(bǔ)償
輸入信號(hào)功率檢測(cè)
高性能、低噪聲鎖相環(huán)(PLL)時(shí)鐘倍頻器
數(shù)字反sinc濾波器
使用NCO實(shí)現(xiàn)數(shù)字正交調(diào)制
“混頻模式”奈奎斯特頻帶選擇
可選1倍、2倍、4倍或8倍插值濾波器
低功耗: 2.11 W(1.6 GSPS時(shí),全部工作條件下)
88引腳LFCSP(帶裸露焊盤)

AD9154應(yīng)用:
無線通信
多載波LTE和GSM基站
寬帶中繼器
軟件定義無線電
寬帶通信
點(diǎn)對(duì)點(diǎn)微波無線電
發(fā)射分集、多路輸入/多路輸出(MIMO)
儀器儀表
自動(dòng)測(cè)試設(shè)備

圖1.AD9154功能框圖

評(píng)估板AD9154-EBZ
The AD9154-EBZ connects to a DPG3. The AD9154 is a quad JESD204B signal processing RF Digital to Analog Converter. The DPG3 automatically formats the data and sends it to the AD9154-EBZ via its JESD204B lanes. The Evaluation Board (EVB) runs from a single +5V lab supply. A clock distribution chip AD9516 is included on this EVB as a clock fan-out and frequency divider for the DACCLK, JESD204B SYSREF signals, and a CFRAME clock used by the DPG3.Hardware Setup

圖2.評(píng)估板AD9154-EBZ建立框圖
 

圖3.評(píng)估板AD9154-EBZ外形圖


圖4.評(píng)估板AD9154-EBZ電路圖(1)

圖5.評(píng)估板AD9154-EBZ電路圖(2)

圖6.評(píng)估板AD9154-EBZ電路圖(3)

圖7.評(píng)估板AD9154-EBZ電路圖(4)

圖8.評(píng)估板AD9154-EBZ電路圖(5)

圖9.評(píng)估板AD9154-EBZ電路圖(6)

圖10.評(píng)估板AD9154-EBZ PCB元件布局圖(頂層)

圖11.評(píng)估板AD9154-EBZ PCB元件布局圖(底層)
 
 
 
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